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CPU与编译器
› VHDL o downto 0 ?
wuyiyinshi
发表于 2008-06-05 12:32
VHDL o downto 0 ?
小弟用xilinx的ip 复用,生成的sram的wea端定义的是(0 downto 0)型,综合的时候过不去,说:Port <wea> of instance <XLXI_3> has different type in definition <sram>.
请问大家怎么解决?在线等
wuyiyinshi
发表于 2008-06-10 16:54
我这样赋值的,可以了:xx<="0",双引号里一个字符,不知道为什么,反正可以仿真了~~
cjaizss
发表于 2008-06-10 19:10
VHDL是要求很严格的语言,类型必须要匹配。
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