Makefile 请教

benjiam

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#        makefile 模版 (by lichuang)
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###################项目路径和程序名称#################################
DIR=$(shell pwd)
BIN_DIR=$(DIR)/bin
LIB_DIR=$(DIR)/lib
SRC_DIR=$(DIR)/src
INCLUDE_DIR=$(DIR)/include
OBJ_DIR=$(DIR)/obj
DEPS_DIR=$(DIR)/deps
#PROGRAM=$(BIN_DIR)/test
PROGRAM=$(BIN_DIR)/test

###################OBJ文件及路径############################################
EXTENSION=c
OBJS=$(patsubst $(SRC_DIR)/%.$(EXTENSION), $(OBJ_DIR)/%.o,$(wildcard $(SRC_DIR)/*.$(EXTENSION)))
DEPS=$(patsubst $(OBJ_DIR)/%.o, $(DEPS_DIR)/%.d, $(OBJS))

###################include头文件路径##################################
INCLUDE=\
                -I$(INCLUDE_DIR)
               
###################lib文件及路径######################################

###################编译选项及编译器###################################
CC=gcc
CFLAGS=-Wall -W -g
LDFLAGS=

###################编译目标###########################################
.PHONY: all clean rebuild

all(OBJS)
        @echo $(DEPS_DIR)
        $(CC) -o $(PROGRAM) $(OBJS) $(LDFLAGS)


$(DEPS_DIR)/%.d: $(SRC_DIR)/%.$(EXTENSION)
        $(CC) -MM $(INCLUDE) $(CFLAGS) $< | sed -e 1's,^,$(OBJ_DIR)/,' > $@

sinclude $(DEPS)

$(OBJ_DIR)/%.o(SRC_DIR)/%.$(EXTENSION)
        $(CC) $< -o $@ -c $(CFLAGS) $(INCLUDE)

rebuild: clean all

clean:
        rm -rf $(OBJS) $(LIB_DIR)/lib* $(BIN_DIR)/*



我准备按照这个为摸班，  按照

make -O2 -s -C project_a_dir -f project_a_makefile -DNDEBUG
        cp project_a_dir/src/liba.a project_a_dir/release/liba.a
        make -O2 -s -C project_b_dir -f project_b_makefile -DNDEBUG
        cd project_c_dir; ./configure ; make; cd -


这样的模式来做。

现在有一个问题

OBJS=$(patsubst $(SRC_DIR)/%.$(EXTENSION), $(OBJ_DIR)/%.o,$(wildcard $(SRC_DIR)/*.$(EXTENSION)))


好象假设所有的code 都在一个目录下面， 而我现在的情况是可能有多子目录

比如/source/
/source/aa
/source/bb

我该如何修改这个makefile?

太平绅士

要不看看 $(foreach) 能不能用? 没玩过呢, 需要尝试.
其实说到SRC_DIR, 还有不爽的问题, 中间有空格怎么办, 有特殊字符怎么办?

prc

原帖由 太平绅士 于 2009-2-27 16:35 发表
要不看看 $(foreach) 能不能用? 没玩过呢, 需要尝试.
其实说到SRC_DIR, 还有不爽的问题, 中间有空格怎么办, 有特殊字符怎么办?

文件名中有空格的应该属于自找麻烦那类的...

chouyatingde

我也才开始写makefile,
不知道这样行不行

%o: /source/%.c
       $(CC) $(CCFLAGS) $(DEFINES) -c -o $@ $<
%o: /source/aa/%.c
       $(CC) $(CCFLAGS) $(DEFINES) -c -o $@ $<
%o: /source/bb/%.c
       $(CC) $(CCFLAGS) $(DEFINES) -c -o $@ $<

[ 本帖最后由 chouyatingde 于 2009-2-27 17:05 编辑 ]

leshy

这不自己找事么？可以有个简单办法。Makefile拷到子目录里。。。

然后写个脚本，依次进去执行make 就行了。。。。

zhuhefang2006

原帖由 chouyatingde 于 2009-2-27 17:03 发表
我也才开始写makefile,
不知道这样行不行

%o: /source/%.c
       $(CC) $(CCFLAGS) $(DEFINES) -c -o $@ $<
%o: /source/aa/%.c
       $(CC) $(CCFLAGS) $(DEFINES) -c -o $@ $<
%o: /source/bb/%.c
...

行不行你实践一下不就知道了吗
建议看一下基本的makefile的写法