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Gvim兄,有一堆体系结构的问题要请教 [复制链接]

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1 [收藏(0)] [报告]
发表于 2005-08-16 11:20 |只看该作者 |正序浏览
问题多多,请谅解,一个人瞎琢磨,搞不定

1, Intel体系结构的数据总线和地址总线是分开的还是复用的?
2, CPU的2级和多级高速缓存,跟片上高速缓存和板上高速缓存有关系吗?比如,Intel的CPU中的板上高速缓存到底是位于物理 上哪个位置?是CPU内部(感觉,不太象,毕竟是“板上”)还是母板?如果是母板,那我们配置机器时母板厂商如果不是Intel,怎能由CPU确知它的Cache的大小?还有,CPU访问板上高速缓存需要总线周期吗?
3, Intel体系的CPU目前有没有采用3级或更多级Cache的?
4, Intel的CPU的Cache是以内存块的物理地址还是虚拟地址做索引的?

还有,体系结构,特别是PC的和一些RISC象MIPS这样的,能推荐本书吗?谢谢

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荣誉版主
日期:2011-11-23 16:44:17
17 [报告]
发表于 2005-08-16 16:09 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

[quote]原帖由 "converse"]汗颜.....工作太忙我最近都没有看书......上个礼拜在公司过了两个晚上....睡眠严重不足中....现在只想睡觉.....[/quote 发表:


注意休息啊,不要太拼命啊。

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16 [报告]
发表于 2005-08-16 15:18 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

汗颜.....工作太忙我最近都没有看书......上个礼拜在公司过了两个晚上....睡眠严重不足中....现在只想睡觉.....

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亥猪
日期:2014-03-19 16:36:35午马
日期:2014-11-23 23:48:46
15 [报告]
发表于 2005-08-16 14:39 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

我觉得难得是因为我编译没有学好,看到VLIW的时候,就总觉得模糊。多处理器与线成级并行,毕竟我没有机会深入到芯片级别去验证,所以都是靠想象,累,还不知道正不正确。如果你基础好的话,肯定比我轻松。
这本书太好了,真正的计算机科学。里面对计算机科学中的平衡取舍,性能价格取舍,都分析的头头是道,用数据和事实说话,而不是国内的“显然”“易得”。

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14 [报告]
发表于 2005-08-16 14:33 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

你都不行,我更加没希望了。我把学校里做教科书的唐老师那本《组成原理》重新看了一遍,总觉得联系不起实际体系来,整机概念,难啊。。

美国计算机协会是ACM啊,ACM会长?我Kao,不用知道是谁,就肯定是顶尖牛人……

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亥猪
日期:2014-03-19 16:36:35午马
日期:2014-11-23 23:48:46
13 [报告]
发表于 2005-08-16 14:28 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

它基本没有讲硬件,都是理论。就是CA设计的理论,硬件是在他们的接口一书里描述。。。我现在也只看到指令集并行,后面的是在看不下去,太抽象。所以只看到了4章 自汗一个。。

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12 [报告]
发表于 2005-08-16 14:23 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

好,多谢多谢!!哈哈,我不想转硬件,只是想培养一下“整机概念”,下周末去买《量化方法》。谢谢~~

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亥猪
日期:2014-03-19 16:36:35午马
日期:2014-11-23 23:48:46
11 [报告]
发表于 2005-08-16 14:20 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

《量化方法研究》经典!!!!强烈推荐。有时间,有精力建议看english版的,
作者一个是斯坦福校长,Mips公司老板之一。
一个是UCB教授,美国计算机协会会长,RAID的创始人
序言的作者是Bill Joy,
。。。。。
不过里面东西确实很深奥。没有恒心和一定基础,可能看到第3、4章就崩溃了。

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10 [报告]
发表于 2005-08-16 13:59 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

谢谢!!待偶慢慢消化~~

我就是看《现代体系的unix》那本书晕晕乎乎的,mips那本出了,我在海图看到了,没买。还有一本《量化方法研究》你看过没,好么?好的话我去买本看看

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亥猪
日期:2014-03-19 16:36:35午马
日期:2014-11-23 23:48:46
9 [报告]
发表于 2005-08-16 13:21 |只看该作者

Gvim兄,有一堆体系结构的问题要请教

兄弟的问题有点模糊,不知道你指的是什么总线,也不知道你指的是什么intel系列的处理器。比如p4与p6的差别就有一些。
在PCI总线上,数据与地址是复用的,然而处理器里面,它的处理器总线的数据、地址线是分开的。在PCI总线上,PCI总线周期通过C/BE信号复用两种总线。在芯片内的处理器总线上,1) 因为pentinum的双处理器或pentinum pro/II/III/VI的多处理器需要通过地址线监听cache命中,2)因为总线业务(transaction)的流水性,所以两者是分开的。(当然还有其它理由)片上cache和外面的cache的区别在于前者是处于以总线接口单元(bus interface unit,它是处理器核心与核心外的接口)划分的处理器核心以内,可以说是属于核心的,L2 cache是放在总线接口单元以外,处理器总线(它是处理器模块与外面的HOST/PCI桥芯片和mem芯片通信的接口)之内,可以说是不属于处理器核心,而属于处理器模块的。
L2的话,一般和处理器核心相距不到1cm,通过专用的后端总线(backside bus)以cpu频率全速与L1 cache通讯,而L3 的cache可以做在主板上,也可以由封装的形式与cpu封装在一起,看形式了(当然不一定是intel的)。L4 我还真没注意。
其实cpu核心并不需要知道Lx cache的大小,它完全可以不管cache大小,就像一个进程也可以不知道物理内存的大小,快慢只是对人来说的,所以才有赛扬与奔腾之分一说。你说的得到cache大小其实是给人看得,具体哪条指令,还真需要查查呵呵。
intel体系的我还没有见过3级以上的,也可能我没有注意吧。
intel P6的索引我记得是线性地址,而不是单纯的物理地址或者虚拟地址,是怎么加在一起成为线性地址然后做的索引。

说了这么罗嗦的多,连我自己都晕乎了不知道兄弟明白没有,呵呵。
不知道你是面向什么应用而需要书,如果是软件需要和体系配合的话,可以看看《现代体系结构上的UNIX系统》,如果是硬件的话,那就是intel architecture manual就足够了免费去intel网站下载。mips的马上北航要出一本《see mips run》的翻译书,但是不知道现在出来没有。
  

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