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楼主: wanyuan111
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[内存管理] 如何使得程序所在的内存页不能被cacke? [复制链接]

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日期:2013-09-04 19:47:39天蝎座
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11 [报告]
发表于 2013-10-26 14:38 |只看该作者
回复 10# wanyuan111


    我粗略了看了下intel的手册,第三卷第11章, 上面提到了通过cr0.cd禁用cache的一些细节。
   不是禁用cr0.cd就可以了. 涉及到芯片是否支持. 不过我没有详细看, 你可以参考下那个手册.

    cr0在第2章, 部分pte标志细节在第4章, cache在第11章.

      期待你的结果.

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12 [报告]
发表于 2013-10-28 11:46 |只看该作者
回复 11# kiongf
我使用另外的方法最终实现了~~~就是内存屏障!
详情看这:http://blog.csdn.net/ture010love/article/details/7651536



   

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发表于 2013-10-28 11:49 |只看该作者
回复 12# wanyuan111
内存屏障跟cache具体有嘛关系?能否具体解释下~~

   

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发表于 2013-10-28 13:17 |只看该作者
回复 12# wanyuan111


    我也好奇怪, memory barrier 怎么和 限制cache 联系上了。
    我唯一想到的是volatile..  编译器强制读取内存

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发表于 2013-10-28 13:57 |只看该作者
回复 14# kiongf

我记得 volatile不保证一定从内存中读取,即使是 volatile一样可能访问的是 cache

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发表于 2013-10-28 19:53 |只看该作者
回复 15# asuka2001


    012 #define barrier() __asm__ __volatile__("": : :"memory")

__volatile告诉编译器此条语句不进行任何优化,"": : :"memory" 内存单元已被修改、需要重新读入。

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发表于 2013-10-28 22:43 |只看该作者
回复 16# kiongf

摘自Documentation/memory-barriers.txt

COMPILER BARRIER
----------------

The Linux kernel has an explicit compiler barrier function that prevents the
compiler from moving the memory accesses either side of it to the other side:

        barrier();


barrier()仅仅是个编译屏障,只是约束编译器,不对 CPU的行为作出约束!
   

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18 [报告]
发表于 2013-10-29 10:22 |只看该作者
回复 17# asuka2001
你们怎么不认真看一下源码呢?关键点在这:
#ifdef CONFIG_X86_32
358 /*
359  * Some non-Intel clones support out of order store. wmb() ceases to be a
360  * nop for these.
361  */
362 #define mb() alternative("lock; addl $0,0(%%esp)", "mfence", X86_FEATURE_XMM2)
363 #define rmb() alternative("lock; addl $0,0(%%esp)", "lfence", X86_FEATURE_XMM2)
364 #define wmb() alternative("lock; addl $0,0(%%esp)", "sfence", X86_FEATURE_XMM)
365 #else
366 #define mb()    asm volatile("mfence":::"memory")
367 #define rmb()   asm volatile("lfence":::"memory")
368 #define wmb()   asm volatile("sfence" ::: "memory")
369 #endif

volatile只是用来告诉编译器不要把本条指令优化,重点是后面的("mfence":::"memory")。
memory强制编译器假设RAM所有内存单元均被汇编指令修改。
mfence:串行化发生在mfence指令之前的读写操作
lfence:串行化发生在mfence指令之前的读操作、但不影响写操作
sfence:串行化发生在mfence指令之前的写操作、但不影响读操作

整条指令的意思就是:每条指令都不能优化,CPU必须且只能在内存中进行数据的读写(间接禁用了cache)。

   

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发表于 2013-10-29 10:30 |只看该作者
回复 18# wanyuan111


我仅仅只是说 volatile不具备约束 CPU必须从主存获取数据的能力以及 barrier()仅仅是编译屏障

至于嵌入汇编中的 memory约束,这个不熟悉,所以可能有误解。。。谢谢指正!


   

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发表于 2013-10-29 10:48 |只看该作者
别扯没用的了, 到底有没有这样的api, 让我分配2 pages还能设置它们为noncachable?


别跟我说用pat


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