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[内核同步] arm 优化屏障 内存屏障 [复制链接]

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1 [收藏(0)] [报告]
发表于 2012-10-29 15:01 |只看该作者 |倒序浏览
本帖最后由 blake326 于 2012-10-29 15:02 编辑

barrier()
mb
wmb
rmb

实际上在arm中都是一个 "":::"memory

和x86大部同啊!

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发表于 2012-10-29 20:46 |只看该作者
这个只是告诉编译器不要优化而已。有这句就够了。

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发表于 2012-10-29 21:02 |只看该作者
鸟了。


    arm也有乱序,我擦。今天看了下好像王洪涛的180多块的超厚的kernel分析什么的。尼玛片子啊。居然说一样的。差点被忽悠。

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发表于 2012-10-29 21:10 |只看该作者
回复 3# blake326


    哎呀,好像也不能怪他。写书的时候好像还没有乱序这个特性,据说a9才有的吧。

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发表于 2012-10-29 21:57 |只看该作者
回复 3# blake326


    你是说CPU乱序吗。这个就看不同的架构实现了。有些架构会提供特殊的指令完成同步操作。
如arm中的dsb,mips中sync等
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