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Makefile问题,忘达人解答 [复制链接]

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发表于 2010-10-21 19:06 |显示全部楼层
是这样的,看到Linux编程大全,讲到Makefile,就照着书上写了一个Makefie,如下
EXECUTABLE =   test
  CC = arm_v5t_le-gcc
  CFLAGS = -Wall -g -o2
  LDFLAGS =
   
  COMPILE = $(CC) $(CFLAGS)
  
  SRC := $(wildcard *.c)
  OBJ := $(patsubst %.c,%.o,$(SRC))
  DEP := $(patsubst %.c,%.d,$(SRC))
  
  include $(DEP)
  
  all: $(EXECUTABLE)
  
  $(EXECUTABLE): $(DEP) $(OBJ)
          $(CC) $(LDFLAGS) -o $(EXECUTALBE) $(OBJ)
  
  %.o:%.c
          @echo "src files: $<"
          @echo "object files $@"
          $(COMPILE) -c $<
  %.d:%.c
          $(CC) -M $< > $@
          $(CC) -M $< | sed s/[.]o/.d/ >> $@
  
  
  .PHONY: clean explain depend
  clean:
          -rm $(OBJ) $(EXECUTABLE) $(DEP) *~
  
  explain:
          @echo "begin"
          @echo "target is $(EXECUTABLE)"
          @echo "Source files: $(SRC)"
          @echo "Object files: $(DEP)"
  
  depend: $(DEP)
          @echo "Dependencies are now up-to-date"



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我先执行make depend生成依赖文件,这一步正常,然后执行make,但是发现只编译出一个.o文件..
请问高手这是为什么啊

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摩羯座
日期:2013-10-10 14:29:04天蝎座
日期:2014-01-03 09:14:49
发表于 2010-10-25 20:53 |显示全部楼层
因为只有一个.c文件?
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