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关于verilog实现的流水CPU [复制链接]

dhclove

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1楼 [收藏(0)] [报告]
发表于 2009-12-13 21:31 |只看该作者 |倒序浏览
在网上找了一下，源码不好找，由于是刚刚接触FPGA，哪位大侠给点指点，谢谢！

[ 本帖最后由 dhclove 于 2009-12-14 15:31 编辑 ]
readkernel

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2楼 [报告]
发表于 2009-12-13 22:06 |只看该作者
http://www.ipcore.cn/index.php?n ... wdownload&cid=5

Description: Gaisler Research provides the LEON processor, a 32-bit synthesisable processor core based on the SPARC V8 architecture. The core is highly configurable, and particularly suitable for system-on-a-chip (SOC) designs.

SPARC V8 architecture 指令为5级流水，这个实现不知道怎样，开源的，自己下。
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readkernel

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3楼 [报告]
发表于 2009-12-13 22:27 |只看该作者
不过是vhdl的
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cjaizss

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4楼 [报告]
发表于 2009-12-13 22:47 |只看该作者
你可以去下一下openrisc
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dhclove

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5楼 [报告]
发表于 2009-12-14 13:35 |只看该作者

回复 #3 readkernel 的帖子

谢谢，不过vhdl的不行啊，能找到verilog的吗？谢谢！
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readkernel

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6楼 [报告]
发表于 2009-12-14 13:39 |只看该作者
open risc
verilog

or1200.rar

207.92 KB, 下载次数: 57
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cjaizss

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7楼 [报告]
发表于 2009-12-14 13:49 |只看该作者
说句题外话,我觉得找资料的能力是开发中最重要的能力,甚至比对基础知识的掌握更重要.
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8楼 [报告]
发表于 2009-12-14 13:55 |只看该作者
原帖由 cjaizss 于 2009-12-14 13:49 发表
说句题外话,我觉得找资料的能力是开发中最重要的能力,甚至比对基础知识的掌握更重要.

完全同意

lz可以去下一个lattice mico32。内有针对lattice fpga的lm32 CPU，6级流水，也是verilog，是基于or1200改进的，还有很多其他的设备ipcore

[ 本帖最后由 readkernel 于 2009-12-14 14:00 编辑 ]
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dhclove

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9楼 [报告]
发表于 2009-12-14 15:32 |只看该作者

回复 #8 readkernel 的帖子

呵呵，说的对，不过我刚刚接触硬件，不知道有哪些不较好的网站或论坛。
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